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环球百事通!FPGA用ROM输出正弦波

来源:博客园


(资料图片仅供参考)

1、创建工程后点击IP Catalog2、在搜索栏搜索ROM,并选择Block Memory Generator3、在弹出来的界面中选择单口ROM4、然后修改位宽和深度(这里根据我的需求设置为8位宽,4096深度);并把使能端口取消;勾上Core Output Register,使数据延迟一个时钟周期输出;由于有primitives Output Register的原因总的会延迟两拍输出。。5、然后打开小梅哥的Mif精灵,选择Xilinx、位宽为8为,深度为4096、最大值为256然后点击OK后在软件所在的文件夹生成coe文件。6、将coe文件放在找得到的地方,并来到Other Options,勾上Load Init File,点击Browse找到coe文件。第4步为将未用到的存储单元填充一个指定的数字,这里填充的数字为0。7、修改名字后点击OK生成该ROM核8、展开IP核,点击verilog文件,可以看到端口模块。(如果生成的是HDL文件,这里建议生成ip核之前将一个Verilog文件设置为顶层,这样就生成Verilog文件了)9、编写tb文件,例化IP核,进行仿真。

10、仿真结果

关键词: 时钟周期 然后点击 在搜索栏